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SPI
STM32H7开发板上使用SPI设备,SCK总线在发送数据完毕后不能及时拉高
发布于 2022-03-14 09:23:56 浏览:1176
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我的开发板上,STM32H7作为SPI主机需要频繁给FPGA发送数据,目前发现连续发送数据时,第一个数据没问题,第二个接收到的数据就出现了错位。其中,STM32H7的SPI配置如下: ``` /* config spi4 bus */ cfg.data_width = 8; cfg.max_hz = 20 * 1000 * 1000;//frequency<=20MHz cfg.mode = RT_SPI_MASTER | RT_SPI_MODE_3 | RT_SPI_MSB; rt_spi_configure(spi4_device, &cfg); ``` 采用了CPHA=1,CPOL=1的mode3模式,根据SPI的时序图,本应该为下面这样: ![2.JPG](https://oss-club.rt-thread.org/uploads/20220314/61b1c0aa9796ededa836ecf5845919b5.jpg.webp) 但是我用signaltap II捕捉后发现是下面这样: ![1.JPG](https://oss-club.rt-thread.org/uploads/20220314/1c5950446921fae542f31af29fbdebd6.jpg.webp) SCK引脚的时钟在传输完毕后没有及时拉高,一直是低电平。这样就会导致紧接着发送下一个数据时,FPGA会识别错位。 如果在两次发送之间加延时,比如10MS,那么问题可以解决,但是这样就拖慢了系统速度。 我想请问SCK引脚控制不是使用的ST官方的HAL库函数来控制的吗?因为如果是HAL库函数控制,我实验了一下,CS引脚拉高同时会把SCK也拉高的。目前这种情况,还有其他解决办法吗?
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StackYuan
认证专家
2022-03-14
这家伙很懒,什么也没写!
可以在drv_spi.c中先看下接口的具体实现,有没有对HAL部分存在使用错误的情况。
红枫
认证专家
2022-03-14
这家伙很懒,什么也没写!
sck脉冲数量不对,还有许多毛刺,感觉像是引脚使用有冲突,其它地方也操作了sck的gpio引脚
TXH97
2022-04-03
这家伙很懒,什么也没写!
看下是不是驱动存在问题,还要就是在官网资料里面找找是不是硬件存在问题,看有没有对应的勘误或者啥的
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anning865
这家伙很懒,什么也没写!
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