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BSP
增加STM32H7BSP，有几个问题
发布于 2019-03-06 11:53:57 浏览：1994
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因为项目需要用到H7系列，看到RTT官方还没有给出支持包，所以自己就尝试了移植了一下，目前已经PR等待审核，目前基础功能可用，但是并没有发挥出H7的性能，由于水平有限，有些问题还没明白，请大佬指点一下。 1，H7有多个RAM，DTCM (128K,速度400M)，AXI（512k ，速度200M），SRAM1 SRAM2 SRAM3 SRAM4 后备SRAM（大小不一，速度200M），那么分配给OS做堆的时候的是选择最大的AXI还是DTCM，当然一个是速度块，一个是空间大 2，cortex_m7系列支持L1 cache,但是没看到F7有很好的支持。
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aozima
2019-03-07
调网络不抓包，调I2C等时序不上逻辑分析仪，就像电工不用万用表！多用整理的好的文字，比截图更省流量，还能在整理过程中思考。
先给楼主点个赞！ 方案1： 建议默认使用DTCM，AXI和剩下的DTCM都做堆，且以AXI为主。 同时的给出 dtcm_malloc给有特殊要求的应用来使用。 然后有特殊性能要求的，手动指定DTCM。 如果DTCM快用完了，建议使用方案2： 默认使用全使用AXI，然后有特殊需要的指定DTCM。 cache需要支持，特别是有DMA操作的驱动代码。 同时内存分配留意cache line对齐。
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whj467467222
认证专家
2019-03-07
开源，分享，交流，共同进步
[i=s] 本帖最后由 whj467467222 于 2019-3-7 18:10 编辑 [/i] >先给楼主点个赞！ --- 感谢aozima老大的回复。 1，我个人也倾向于使用DTCM，但是开放给其他用户使用的话，在README里面应该增加说明。 2，使用dtcm_malloc的话，未来RTT会做出支持吗？ 3，cache的支持有，目前社区好像没有看到更多的资料 4，如果支持cache的话DMA部分需改的东西还会有很多，而且在启动OS之前还有CACHE的使能，那么有必要再建一个有CACHE的STM MCU的BSP目录吗？ **********分割线********** 在阿莫论坛看到您写的有关FPU的回答，但是链接我无法打开，不知道您能复制一份过来吗？ 原文如下 RT-Thread已支持此特性: [http://www.amobbs.com/thread-5151618-1-1.html](http://www.amobbs.com/thread-5151618-1-1.html) 不仅不浪费保存的时间，连空间都不用预留，这样线程栈空间要求小很多。 原文链接：[https://www.amobbs.com/thread-5601374-1-44.html?_dsign=c955364d](https://www.amobbs.com/thread-5601374-1-44.html?_dsign=c955364d)
aozima
2019-03-07
调网络不抓包，调I2C等时序不上逻辑分析仪，就像电工不用万用表！多用整理的好的文字，比截图更省流量，还能在整理过程中思考。
>不仅不浪费保存的时间，连空间都不用预留，这样线程栈空间要求小很多。 看下arm官网的这个文档： https://developer.arm.com/docs/dai0298/latest DAI0298A Application Note 298 Cortex-M4(F) Lazy Stacking and Context Switching
whj467467222
认证专家
2019-03-08
开源，分享，交流，共同进步
谢谢
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