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DMA
CACHE
关于 DMA 和 Dcache 操作的疑惑？
发布于 2021-07-13 10:22:02 浏览：1273
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平台是 aarch64 ，采用dma传输数据。 ```c sar = rt_calloc(1, 256); dar = rt_calloc(1, 256); if ((sar == RT_NULL) || (dar == RT_NULL)) { rt_kprintf("can not alloc memory\n"); return; } rt_kprintf("sar addr 0x%x\n", sar); rt_kprintf("dar addr 0x%x\n", dar); for (int i = 0; i < 256; i++) { sar[i] = 0xa5; } rt_hw_dcache_flush_range((unsigned long)sar, 256); //数据源 // rt_hw_dcache_flush_range((unsigned long)dar, 256); //目的地址 rt_kprintf("data prepare done\n"); dmac_trans(&dmac1); rt_hw_dcache_invalidate_range((unsigned long)dar, 256); ``` 代码如上，如果屏蔽掉flush目的区域的话，dma传输完成之后的数据就有问题。（申请的memory 是 MEM_ATTR_MEMORY 属性） 从原理上讲，不应该在dma传输之前 flush 源区域，dma传输之后 无效化目的区域吗？这里有点疑惑。
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aozima
2021-07-13
调网络不抓包，调I2C等时序不上逻辑分析仪，就像电工不用万用表！多用整理的好的文字，比截图更省流量，还能在整理过程中思考。
我是这样分析的： - 在dar的calloc操作中，CPU对dar进行了清0操作， - 此时数据至少有部分在cache中，也有可能会有部分已在RAM中了，这个是不可控的。 - 那么在DMA的传输过程中，说不定CACHE会因空间不够，自动再把部分数据刷入RAM，所以造成的数据出错。 所以， - 要么malloc不用calloc，这样CPU对dar没有操作，dar就和cache没关系。 - 要么明确的在DMA之前把dar的数据刷入RAM中，这样就不会在中途自动刷。
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liuduanfei
这家伙很懒，什么也没写！
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