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risc-v_RISCV
risc-v移植,中断异常exception,切中断栈
发布于 2024-08-19 16:06:28 浏览:85
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[tocm] ## 描述: 移植RTT到risc-v内核上,裸机下中断时正常的,移植时中断和上下文切换使用`libcpu\risc-v\interrupt_gcc.S`和`context_gcc.S`,方法参考的是`libcpu\risc-v\readme.md`,把MTVEC设置成SW_handler ## 问题: 每次中断时可以进到`SW_handler`,执行到`call rt_interrupt_enter`时又会跳到SW_handler, 怀疑是`csrrw sp,mscratch,sp`这里有问题, 没搞懂切中断栈,求指点谈论。 ![微信图片_20240819160521.png](https://oss-club.rt-thread.org/uploads/20240819/3e4649f07b53d37e948f94eb9d03486a.png.webp)
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rv666
认证专家
2024-08-27
调网络不抓包,调I2C等时序不上逻辑分析仪,就像电工不用万用表!多用整理的好的文字,比截图更省流量,还能在整理过程中思考。
应该是你中断栈设置问题: 解决办法: https://github.com/RT-Thread/rt-thread/tree/master/libcpu/risc-v 看一下这里,csrrw sp,mscratch,sp本意是用于交换线程栈与中断栈,如果上述按照移植指南的话,关注一下这句, la t0, __rt_rvstack,在链接脚本中添加一下这个符号
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ζ???本
这家伙很懒,什么也没写!
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